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安華高用40nm CMOS工藝實現(xiàn)25G SerDes

摘要:安華高宣布,已經(jīng)用40nm CMOS工藝技術實現(xiàn)25Gbps的SerDes。Avago SerDes內核的主要特點在于采用獨特的判斷反饋均衡(DFE, Decision Feedback Equalization)技術,帶來更低的總體功耗和同類產(chǎn)品中最佳的數(shù)據(jù)延遲、抗噪能力、抖動和串擾表現(xiàn)。
       Avago Technologies(安華高科技)日前宣布,已經(jīng)用40nm CMOS工藝技術實現(xiàn)25Gbps的SerDes。Avago SerDes內核的主要特點在于采用獨特的判斷反饋均衡(DFE, Decision Feedback Equalization)技術,帶來更低的總體功耗和同類產(chǎn)品中最佳的數(shù)據(jù)延遲、抗噪能力、抖動和串擾表現(xiàn)。由于Avago采用了模塊化和多速率結構,它的SerDes內核具有非常高的集成度,容易實現(xiàn)數(shù)百個通道的設計。

      Avago豐富廣泛的SerDes產(chǎn)品非常適合光纖、銅纜和背板應用,并支持PCI Express、光纖通道、XAUI、CEI-11G、10GBASE-KR和SFI等標準。

       目前Avago SerDes的出貨總通道數(shù)已經(jīng)超過九千五百萬,Avago在提供高可靠性且高性能的ASIC產(chǎn)品上擁有輝煌的紀錄,并通過超過30年的設計經(jīng)驗、成熟領先的階層式設計方法以及涵蓋多重標準的知識產(chǎn)權,形成提供網(wǎng)絡連線、計算和存儲應用功能復雜ASIC產(chǎn)品的成功基礎。
內容來自:光波通信
本文地址:http://m.odinmetals.com//Site/CN/News/2010/02/26/20100226082426332750.htm 轉載請保留文章出處
關鍵字: 安華高 CMOS工藝 SerDesy
文章標題:安華高用40nm CMOS工藝實現(xiàn)25G SerDes
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